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1/* SPDX-License-Identifier: MIT */2/*3 * Copyright © 2021-2023 Intel Corporation4 */5 6#ifndef _XE_MMIO_H_7#define _XE_MMIO_H_8 9#include "xe_gt_types.h"10 11struct xe_device;12struct xe_reg;13 14int xe_mmio_init(struct xe_device *xe);15int xe_mmio_probe_tiles(struct xe_device *xe);16 17u8 xe_mmio_read8(struct xe_gt *gt, struct xe_reg reg);18u16 xe_mmio_read16(struct xe_gt *gt, struct xe_reg reg);19void xe_mmio_write32(struct xe_gt *gt, struct xe_reg reg, u32 val);20u32 xe_mmio_read32(struct xe_gt *gt, struct xe_reg reg);21u32 xe_mmio_rmw32(struct xe_gt *gt, struct xe_reg reg, u32 clr, u32 set);22int xe_mmio_write32_and_verify(struct xe_gt *gt, struct xe_reg reg, u32 val, u32 mask, u32 eval);23bool xe_mmio_in_range(const struct xe_gt *gt, const struct xe_mmio_range *range, struct xe_reg reg);24 25u64 xe_mmio_read64_2x32(struct xe_gt *gt, struct xe_reg reg);26int xe_mmio_wait32(struct xe_gt *gt, struct xe_reg reg, u32 mask, u32 val, u32 timeout_us,27 u32 *out_val, bool atomic);28int xe_mmio_wait32_not(struct xe_gt *gt, struct xe_reg reg, u32 mask, u32 val, u32 timeout_us,29 u32 *out_val, bool atomic);30 31static inline u32 xe_mmio_adjusted_addr(const struct xe_gt *gt, u32 addr)32{33 if (addr < gt->mmio.adj_limit)34 addr += gt->mmio.adj_offset;35 return addr;36}37 38#endif39