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1/* SPDX-License-Identifier: GPL-2.0-only */2/*3 * Copyright (c) 2022 MediaTek Inc.4 * Author: Ping-Hsun Wu <ping-hsun.wu@mediatek.com>5 */6 7#ifndef __MDP_REG_WROT_H__8#define __MDP_REG_WROT_H__9 10#define VIDO_CTRL 0x00011#define VIDO_MAIN_BUF_SIZE 0x00812#define VIDO_SOFT_RST 0x01013#define VIDO_SOFT_RST_STAT 0x01414#define VIDO_CROP_OFST 0x02015#define VIDO_TAR_SIZE 0x02416#define VIDO_OFST_ADDR 0x02c17#define VIDO_STRIDE 0x03018#define VIDO_OFST_ADDR_C 0x03819#define VIDO_STRIDE_C 0x03c20#define VIDO_CTRL_2 0x04821#define VIDO_DITHER 0x05422#define VIDO_STRIDE_V 0x06c23#define VIDO_OFST_ADDR_V 0x06824#define VIDO_RSV_1 0x07025#define VIDO_DMA_PREULTRA 0x07426#define VIDO_IN_SIZE 0x07827#define VIDO_ROT_EN 0x07c28#define VIDO_FIFO_TEST 0x08029#define VIDO_MAT_CTRL 0x08430#define VIDO_SCAN_10BIT 0x0dc31#define VIDO_PENDING_ZERO 0x0e032#define VIDO_BASE_ADDR 0xf0033#define VIDO_BASE_ADDR_C 0xf0434#define VIDO_BASE_ADDR_V 0xf0835 36/* MASK */37#define VIDO_CTRL_MASK 0xf530711f38#define VIDO_MAIN_BUF_SIZE_MASK 0x1fff7f7739#define VIDO_SOFT_RST_MASK 0x0000000140#define VIDO_SOFT_RST_STAT_MASK 0x0000000141#define VIDO_TAR_SIZE_MASK 0x1fff1fff42#define VIDO_CROP_OFST_MASK 0x1fff1fff43#define VIDO_OFST_ADDR_MASK 0x0fffffff44#define VIDO_STRIDE_MASK 0x0000ffff45#define VIDO_OFST_ADDR_C_MASK 0x0fffffff46#define VIDO_STRIDE_C_MASK 0x0000ffff47#define VIDO_CTRL_2_MASK 0x0000000f48#define VIDO_DITHER_MASK 0xff00000149#define VIDO_STRIDE_V_MASK 0x0000ffff50#define VIDO_OFST_ADDR_V_MASK 0x0fffffff51#define VIDO_RSV_1_MASK 0xffffffff52#define VIDO_DMA_PREULTRA_MASK 0x00ffffff53#define VIDO_IN_SIZE_MASK 0x1fff1fff54#define VIDO_ROT_EN_MASK 0x0000000155#define VIDO_FIFO_TEST_MASK 0x00000fff56#define VIDO_MAT_CTRL_MASK 0x000000f357#define VIDO_SCAN_10BIT_MASK 0x0000000f58#define VIDO_PENDING_ZERO_MASK 0x07ffffff59#define VIDO_BASE_ADDR_MASK 0xffffffff60#define VIDO_BASE_ADDR_C_MASK 0xffffffff61#define VIDO_BASE_ADDR_V_MASK 0xffffffff62 63#endif // __MDP_REG_WROT_H__64